MIH: Resumen del tipo

Tipo de ítem DEC J-11 (Jaws)

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JERARQUÍA TIPOS ATRIBUTO VALOR ASIGNADOR
Ítem lógico año de comercialización 1983 DEC J-11 (Jaws)
Componentes (*) Ítem lógico Ítem lógico
Descripción
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 DEC J-11 (Jaws)
Hardware fabricante DEC DEC J-11 (Jaws)
CPU #transistores 40.000 (data chip) + 80.000 (control chip) DEC J-11 (Jaws)
arquitectura 16 bits PDP-11 DEC J-11 (Jaws)
Memoria máxima 4 MB DEC J-11 (Jaws)
velocidad 3.75-4.50MHz DEC J-11 (Jaws)
DEC J-11 (Jaws) No existen atributos propios

Descripción

Se trata de la tercera y última implementación de la arquitectura PDP-11, soportando todas sus instrucciones, y la primera en usar tecnología CMOS.

Como su predecesor, el J-11, está compuesto de dos chips (de data y de control) en un único soporte DIP de 60 pines.

Se uso por primera vez en el PDP-11/73 (1983).
Se trata de la tercera y última implementación de la arquitectura PDP-11, soportando todas sus instrucciones, y la primera en usar tecnología CMOS. Como su predecesor, el J-11, está compuesto de dos chips (de data y de control) en un único soporte DIP de 60 pines. Se uso por primera vez en el PDP-11/73 (1983).

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Última actualización: 09/11/2022

Creación de la web: 30/10/2010

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